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隔离栅极驱动器的应用场景较为复杂和多样,在一些高频、大功率和存在噪声的场景下,隔离栅极驱动器可能会出现误动作甚至导致器件损坏。同时,不合理的PCB布局和外围电路设计也可能会导致上述问题。因此,本文基于Pai8233X系列隔离栅极驱动器,从芯片的基本应用建议、芯片高压侧多路供电方案到栅极驱动器中输入窄脉冲的影响,讨论了芯片在应用过程中可能存在的风险,旨在给出适当建议缓解上述风险带来的不利影响。 一、应用建议 1.1供电选项 图1 Pai8233X(WB SOIC-14)引脚定义及去耦电容的连接 Pai8233X(WB SOIC-14)的引脚定义如图1所示,其逻辑侧供电范围为3-5.5V;高压侧的VDDA/VDDB能够接受最大25V的工作电压,而其供电的下限则需参考不同型号的UVLOon。此外,为减少电源纹波和过电压应力事件,在逻辑侧推荐VCCI引脚至GND引脚采用100nF和1uF的低ESR和低
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